요약
23.12.31 ~ 24.01.16 약 16일간 베릴로그 기초 문법을 공부했다.
마크다운 노트 페이지를 복붙 했기에 블로그 글 가독성이 떨어진다.
앞으로 종종 글을 이쁘게 수정할 예정.
Verilog 기초 문법 A to Z
1. Module의 기초에 대하여
2024.01.02 - [Verilog/Basic] - [Verilog Tutorial] Level-1 Basic Verilog Module 모음
[Verilog Tutorial] Level-1 Basic Verilog Module 모음
2023.12.31 - [Verilog/Basic] - [Basic Verilog Module] 1. Verilog 의 구조 [Basic Verilog Module] 1. Verilog 의 구조 (https://fpgatutorial.com의 내용을 정리함.) 1. Structuring Verilog Code FPGA Verilog 코딩은 HW 디자인이다. 컴퓨터 프
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2. 데이터 Type, 배열 등
2024.01.02 - [Verilog/Basic] - [Verilog Tutorial] Level-2 Verilog Data Types and Arrays 모음
[Verilog Tutorial] Level-2 Verilog Data Types and Arrays 모음
2024.01.02 - [Verilog/Basic] - [Verilog Data Types and Arrays] 1. Data 표현 [Verilog Data Types and Arrays] 1. Data 표현 Verilog 를 쓸 때, digital data 값을 code로 표현해야 함. binary (2진수) hexadecimal (16진수) octal (8진수) 등. 데
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3. 연산자 (Operators) 정리 모음
2024.01.04 - [Verilog/Basic] - [Verilog Tutorial] level-3 Verilog Operators 모음
[Verilog Tutorial] level-3 Verilog Operators 모음
2024.01.04 - [Verilog/Basic] - [Verilog Operator] 1. 비트 연산자 [Verilog Operator] 1. 비트 연산자 Operator (연산자) 에 대해서 배울 예정 디지털 데이터를 처리하는 방법을 제공 대부분의 경우 verilog operators를 사
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4. 조합 논리 회로 설계하기 (time X) - 멀티플렉서 설계 in Verilog
2024.01.10 - [Verilog/Basic] - [Verilog Tutorial] level-4 Using Continuous Assignment 모음
[Verilog Tutorial] level-4 Using Continuous Assignment 모음
2024.01.10 - [Verilog/Basic] - [Using Continuous Assignment] 1. 연속 할당 in 베릴로그 [Using Continuous Assignment] 1. 연속 할당 in 베릴로그 assign 키워드 사용 continuous Assignment in Verilog verilog net types 에서 data를 구동시
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5. 순차 논리 회로 설계하기 (time O) - D 플립플롭 설계 in Verilog
2024.01.10 - [Verilog/Basic] - [Verilog Tutorial] level-5 Using the Always Block 모음
[Verilog Tutorial] level-5 Using the Always Block 모음
2024.01.10 - [Verilog/Basic] - [Using the Always Block] 1. Always block 이란? [Using the Always Block] 1. Always block 이란? always block 순차적으로 실행되는 코드 작성 sequential logic 을 설명할 때 매우 중요. 예제 풀이 전에
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6. 테스트벤치 코드 작성법
2024.01.13 - [Verilog/Basic] - [Verilog Tutorial] level-6 Testbench 모음
[Verilog Tutorial] level-6 Testbench 모음
2024.01.10 - [Verilog/Basic] - [Testbench] 1. 테스트벤치의 구조 [Testbench] 1. 테스트벤치의 구조 Verilog 설계 시, testbench 코딩을 통해 예상대로 작동하는지 확인. testbench 코딩 언어 VHDL Verilog System Verilog 업계
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7. 조건문 in Verilog - if문, case문
2024.01.13 - [Verilog/Basic] - [Verilog Tutorial] level-7 Statement 모음
[Verilog Tutorial] level-7 Statement 모음
2024.01.13 - [Project] - [Statement] 1. if문 [Statement] 1. if문 if statement 와 case statement 에 대해 배울 것. (복습) always blocks 등의 procedural blocks를 쓰는 이유? 순차적으로 실행되는 베릴로그 code를 작성하기 위
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8. 반복문 in Verilog - loops
2024.01.16 - [Verilog/Basic] - [Verilog Tutorial] level-8 Loops 모음
[Verilog Tutorial] level-8 Loops 모음
2024.01.16 - [Verilog/Basic] - [Loops] 1. 베릴로그 loop문 [Loops] 1. 베릴로그 loop문 loop for loop while loop forever loop repeat loop 데이터가 할당되는 방식을 제어 sequential statements always, initial block 등의 procedural blocks
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9. Task와 함수 선언 및 호출
2024.01.16 - [Verilog/Basic] - [Verilog Tutorial] level-9 Function and Task 모음
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2024.01.16 - [Verilog/Basic] - [Function and Task] 1. 베릴로그 함수 [Function and Task] 1. 베릴로그 함수 subprograms tasks functions reusable한 코드를 작성할 수 있음. 최대한 reusable하게 만드는것이 좋음. function과 task
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10. Parameter와 생성문 - Reusable Code 작성을 위한 도구들
2024.01.16 - [Verilog/Basic] - [Verilog Tutorial] level-10 Reusable Code 모음
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2024.01.16 - [Verilog/Basic] - [Reusable Code] 1. 매개변수 [Reusable Code] 1. 매개변수 reusable code parameters 사용 parameterized module generate 문 generate for block generate if block generate case block Verilog Parameter 모듈을 인스턴
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열공. 화이팅.